作为分频器的IC2 开始计数分频。当计数到10 时,Q4 输出高电平,该高电平经D1 反相变为低电平使VT 截止,继电器断电释放,切断被控电路工作电源。通电后时基振荡器震荡经过分频后可向外输出时基信号。
CD4060由一振荡器和14级二进制串行计数器位组成,振荡器的结构可以是RC或晶振电路,CR为高电平时,计数器清零且振荡器使用无效。所有的计数器位均为主从触发器。在CP1(和CP0)的下降沿计数器以二进制进行计数。在时钟脉冲线上使用斯密特触发器对时钟上升和下降时间无限制。
与此同时, D1 输出饿低电平经D2 反相为高电平后加至IC2 的CP 端,使输出端输出的高电平保持。电路通电使IC1、IC2 复位后,IC2 的四个输出端,均为低电平。而Q4 输出的低电平经D1 反相变为高电平,通过R4 使VT 导通,继电器通电吸和。这种工作状态为开机接通、定时断开状态。
精确长延时原理电路图